Vorbereitung auf die Zukunft: Wie man Software-Defined Vehicle (SDV) Ready wird

White Paper: Automotive

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Der Übergang von traditionellen elektrischen/elektronischen (E/E) Fahrzeugarchitekturen zu Software-Defined Vehicles (SDVs) hat die Nachfrage nach Entwicklungstools erheblich erhöht. Die Wahl geeigneter Lösungen wird durch neue heterogene Multi-Core-High-Performance-Chips und hochkomplexe Software-Stacks in einer virtualisierten Umgebung begrenzt. Laden Sie Lauterbachs White Paper herunter, um zu erfahren, wie „SDV Ready“ Lösungen Automobilentwickler dabei unterstützen, die Entwicklung von heutigen und zukünftigen SDVs zu beschleunigen und zu vereinfachen.

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Übersicht

Dieses Whitepaper von Lauterbach GmbH skizziert den Übergang von traditionellen domänenbasierten Fahrzeugarchitekturen zum Software Defined Vehicle (SDV) Paradigma und betont die erhöhte Komplexität und die Anforderungen, die diese Evolution an Entwicklung, Debug- und Trace-Tools stellt.

Das SDV-Konzept zentriert sich auf Fahrzeuge, deren Funktionen und Features vorwiegend software-getrieben sind, ermöglicht durch zunehmend leistungsfähige, heterogene Multi-Core-SoCs, die zahlreiche einfachere ECUs ersetzen. Dieser Wandel wird durch Trends in Elektrifizierung, Automatisierung und Konnektivität getrieben und erfordert umfangreiche Software-Stacks, die in virtualisierten Umgebungen mit Container-Technologien operieren. SDVs ermöglichen Over-the-Air-Updates, neue Feature-Bereitstellung aus App-Stores und liefern Herstellern Daten für Lebenszyklusmanagement und Serviceverbesserungen.

SDVs bewegen sich von domänenbasierten Architekturen – wo viele domänenspezifische ECUs kollaborieren – zu zonalen Architekturen. In zonalen Architekturen sind weniger, aber leistungsstärkere Steuergeräte räumlich in Fahrzeugzonen organisiert, verbunden über High-Speed-Ethernet-Backbones und fähig, diverse Workloads zu bewältigen, einschließlich sicherheitskritischer Echtzeitsteuerung. Zentrale High-Performance-SoCs wie Qualcomm Snapdragon, Nvidia Drive Orin oder NXPs Prozessoren integrieren multiple heterogene Kerne (Arm Cortex-A/R, DSP-Beschleuniger), um dies zu unterstützen.

Das Papier betont die Notwendigkeit leistungsstarker, flexibler Debug- und Trace-Tools, die auf diese Anforderungen zugeschnitten sind. Lauterbachs TRACE32® wird als „SDV Ready“ hervorgehoben, unterstützt Multi-Core-Heterogen-Debug, Echtzeit-Trace-Erfassung und Hypervisor-bewusstes Debugging mit simultaner OS-bewusster Inspektion über virtuelle Maschinen. Es unterstützt eine umfangreiche Palette von Betriebssystemen, einschließlich AUTOSAR Classic und Adaptive Plattformen, POSIX-Betriebssysteme (Linux, QNX) und containerisierte Anwendungen.

Zu den Schlüsselfunktionen gehören breite Emulations- und Virtual-Target-Unterstützung für frühe Entwicklung („Shift Left“) vor Siliziumverfügbarkeit, nahtloses Debugging über virtuelle und physische Targets hinweg und Cloud-Debugging-Integration, exemplarisch durch Corelliums virtualisierte Arm Automotive Reference Platform auf Amazon AWS Graviton-Prozessoren.

Insgesamt unterstreicht das Dokument, dass robuste, funktionsreiche Debug- und Trace-Tooling, fähig zum Handling komplexer heterogener Multi-Core-SoCs, hypervisierter und Container-Umgebungen sowie virtueller Plattformen, essenziell ist, um SDVs erfolgreich über ihren Lebenszyklus zu entwickeln und zu warten. TRACE32® positioniert sich als umfassende Lösung, die diese Herausforderungen über den gesamten Software-Stack hinweg adressiert – von virtuellen ECUs bis zu echtem Silizium – und effiziente SDV-Entwicklung ermöglicht.