Fortgeschrittenes VHDL-Quiz – Teil 3
Tutorials 12‑17 der Basic VHDL Serie absolvieren und Wissen mit diesem gezielten Quiz testen.
Frage 1: Was ist wahr über den signed Typ?
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Frage 2: Was ist äquivalent zu diesem Concurrent Process?
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Frage 3: Welchen Wert hat Output nach Ausführung dieses Codes?
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Frage 4: Was ist wahr über die Port-Deklaration?
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Frage 5: Wie erscheinen Werte, die per Generic Map übergeben werden, im Modul?
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Frage 6: Was bedeutet „Setup Time“ für ein Flip-Flop?
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Frage 7: Warum ignorieren wir Setup/Hold Time normalerweise beim VHDL-Design?
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Basic VHDL Quiz – Teil 3
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VHDL
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