74LS74 Dual D-Flip-Flop: Referenz, Pinout & Wahrheitstabelle
Flip-Flops/Latches sind ICs mit zwei stabilen Zuständen zur Speicherung in Sequenzlogik. Typen: SR-Latch, JK-FF, D-FF. Der 74LS74 ist ein Dual-D-Flip-Flop (zwei unabhängige D-FFs). Weitreichende Betriebsbedingungen, breiter Spannungsbereich → auch bistabiler Multivibrator genannt.
Guide deckt Pinout, Eigenschaften, Äquivalente, Funktionsweise, Schaltung ab.
74LS74 Pinbelegung
| Pin | Symbol | Name | Funktion |
|---|---|---|---|
| 14 | Vcc/Vdd | Versorgungsspannung | ~5 V für IC |
| 7 | Vss/GND | Masse | System-GND |
| 10, 4 | 2PRE̅, 1PRE̅ | Preset/Set (aktiv Low) | Asynchroner Set-Eingang |
| 12, 2 | 2D, 1D | Dateneingang | D-Eingang der Flip-Flops |
| 13, 1 | 2CLR̅, 1CLR̅ | Clear/Reset (aktiv Low) | Löscht FF-Speicher → Reset |
| 11, 3 | 2CLK, 1CLK | Takteingang | Taktflanke (steigend) für FF |
| 8, 6 | 1Q̅, 2Q̅ | Komplementärausgang | Invertierter Q-Ausgang |
| 9, 5 | 2Q, 1Q | Ausgang | Normaler Q-Ausgang |
74LS74 Wahrheitstabelle (Funktions-tabelle)
| EINGÄNGE | AUSGÄNGE | ||||
|---|---|---|---|---|---|
| PRE̅ | CLR̅ | CLK | D | Q | Q̅ |
| L | H | X | X | H | L |
| H | L | X | X | L | H |
| L | L | X | X | H | H |
| H | H | ↑ | H | H | L |
| H | H | ↑ | L | L | H |
| H | H | L | X | Q0 | Q̅0 |
X = Don't Care. ↑ = steigende Taktflanke. Q0 = vorheriger Zustand. Asynchrone Set/Reset (Low-aktiv) dominieren über Takt.
74LS74 Eigenschaften
- Betriebsspannung: 2–15 V
- Betriebstemperatur: 0–70 °C
- Eingang: Bipolar; Ausgang: Push-Pull
- High-Level-Ausgangsstrom: 8 mA; Laufzeitverzögerung: 40 ns
- Max. Low-Level-Eingang: 0,8 V; Min. High-Level-Eingang: 2 V
- Gehäuse: 14-Pin SOT42 / SO-14
Äquivalente
- 74LVC2G80
- HEF40312B
74LS74 Dual-D-Flip-Flop – Einführung
Zwei D-FFs (D = Data/Delay) mit komplementären Ausgängen, asynchronem Preset/Clear. Speichert Binärwerte. Datenübernahme an steigender Taktflanke. Direkte Anbindung an NMOS, TTL, CMOS. Hoher Spannungsbereich. Low an Preset/Reset setzt Ausgabe gemäß Logikpegel.
Anwendung des 74LS74
- IC versorgen (Vcc/GND).
- Jedes FF arbeitet autonom. FF1: Eingänge Pin 2,3 → Ausgänge Pin 5,6. FF2: Eingänge Pin 11,12 → Ausgänge Pin 8,9.
Hinweis: Pin 3 (1CLK) benötigt Taktsignal (PWM von NE555 oder MCU). Kann auch zum asynchronen Reset genutzt werden (High an Clear).
Funktions-tabelle (wie oben) gilt für beide FFs identisch.
Simulation
Logikbits/Status zur Prüfung nutzen. Oder Real-Schaltung. GIF-Illustration unten kombiniert mit Tabelle für besseres Verständnis.
Anwendungsgebiete
- Puffer-Schaltungen
- Latch-Schaltungen / Speicherzellen
- Netzwerkgeräte
- Schieberegister
- Digitalelektronik
- PCs, TVs, Notebooks
- Abtastschaltungen
- Steuer-/Speicherregister
Fazit
74LS74 = High-Speed D-Flip-Flop mit positiver Flankentriggerung. 74XXYY-Serie, kompatibel zu MCU/TTL (Schottky-TTL). Bei Fragen: kontaktieren Sie uns.
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