Blind- und Buried-Via-Design für High-Speed-Digital-PCBs meistern
Mit zunehmender Anwendung großskaliger/ultra-großskaliger ICs zeigen Leiterplatten Trend zu Multilayer und Komplexität (steigende Chip-Integration, schrumpfendes Volumen, mehr Pins, höhere Speed-Rates). Die meisten High-Speed-Multilayer-PCBs nutzen Through-Hole-Vias für Layer-Verbindungen. Für elektrische Verbindungen, die nicht Top-to-Bottom verlaufen, entstehen redundante Via-Stubs → PCB-Transmissionsqualität stark beeinträchtigt. Bei High-Performance-High-Speed-Digital-Systemen ist Stub-Einfluss nicht vernachlässigbar. Basierend auf Cost-vs-Performance-Abwägung: Blind/Buried-Via-Design vermeidet redundante Stubs effektiv, steigert System-Transmissionsqualität.
Forschungsobjekte: Blind/Buried Vias. Durch Modeling/Simulation: Analyse von Via-Durchmesser, Pad, Anti-Pad auf Signalmerkmale (S-Parameter, Impedanzkontinuität). Praktische Anleitung für High-Speed-PCB Blind/Buried-Via-Design.
Hauptparameter und Performance-Indizes von Blind/Buried Vias
Für High-Speed-Digital-Multilayer-PCBs: Vias nötig für High-Speed-Signalverbindung zwischen Interconnects verschiedener Ebenen. Vias = elektrische Leiter zwischen Routings verschiedener Ebenen. Klassifikation (Abb. 1):
- Through-Hole Vias: Durch gesamtes PCB; Layer-Interconnects oder Positionier-Vias für Bauteile.
- Blind Vias: Nicht durch gesamtes PCB; Verbindung interne Layer ↔ Surface-Routing.
- Buried Vias: Nur interne Layer-Verbindung. Von PCB-Außenseite nicht sichtbar.

Vias ≠ reine elektrische Verbindung – Signalintegritätseinfluss beachten. Verständnis der Via-Architektur auf High-Speed-Digital-Performance → exzellente Signalintegritätslösung → Design-Optimierung, verbesserte High-Speed-Signal-Transmissionsqualität.
Äquivalentes Elektrisches Via-Modell in High-Speed-Schaltungen (Abb. 2): C₁, C₂, L = parasitäre Kapazitäten/Induktivität.

Parasitäre Kapazität zu Ground: C = (ε·π·D₁·D₂)/(D₁-D₂) · h
. D₁: Anti-Pad-Durchmesser zu Ground; D₂: Via-Pad-Durchmesser; ε: Dielektrizitätskonstante; h: PCB-Dicke. In High-Speed-Digital: Parasitäre Kapazität verlangsamt Signal-Rise-Time, bremst Schaltung. Für Transmission Line Z₀: Beziehung parasitäre Kapazität ↔ Rise-Time
.
Parasitäre Induktivität bei High-Speed-Signalen durch Vias. Einfluss > parasitäre Kapazität. L = 5.08·h·[ln(4h/d) + 1]
. h: Via-Länge; d: Via-Durchmesser. Äquivalente Impedanz durch parasitäre Induktivität nicht vernachlässigbar. Beziehung: Z_eq ∝ L/(C·t_r)
.
Aus Formeln: Elektrische Via-Performance ändert sich mit Designparametern. Via-Durchmesser, Länge, Pad, Anti-Pad → Impedanzdiskontinuität, Signalintegrität stark beeinflusst. Analyse basiert auf S₁₁ (Return Loss) und S₂₁ (Insertion Loss). Effektive Bandbreite bei Insertion Loss < -3 dB. TDR-Simulation für Reflexionsanalyse durch Impedanzdiskontinuität.
Modeling-Simulation und Ergebnisanalyse Blind/Buried Vias
8-Layer-PCB-Modell mit HFSS (Abb. 3).

Layer 1-2, 4-5, 7-8: Signal; Layer 3: Power; Layer 6: Ground. Layerdicke 0,2 mm (8 mil); FR4, ε=4. Signal-Routing: Breite 0,1 mm (4 mil), Dicke 0,13 mm (1,1 mil). Simulation: Rise-Time 20 ps, Max Sweep 100 GHz.
Vergleich: Blind/Buried Vias vs. Through-Hole Vias
Layer 1 → 5 (Blind Via): Radius 0,1 mm (4 mil), Länge 0,81 mm (32 mil). Vergleich: Through-Hole Via, Radius 0,1 mm, Stub-Länge 0,6 mm.
- 40–80 GHz: Blind Via S₁₁ = 4–7 dB; Through-Hole S₁₁ = 4–10 dB.
- Max Insertion Loss: Blind Via @ 76 GHz; Through-Hole @ 52 GHz.
- Bandbreite (IL < -3 dB): Blind Via 22 GHz; Through-Hole 15 GHz.
- Charakteristische Impedanz: Blind Via 46–52 Ω; Through-Hole 42–53 Ω → Blind Via bessere Impedanzkontinuität.
Fazit: Blind Vias bessere Transmissionsqualität (Top↔Internal, Bottom↔Internal).
Layer 2 → 5 (Buried Via): Radius 0,1 mm, Länge 0,57 mm. Vergleich: Through-Hole, Radius 0,1 mm, Stub L1→2: 0,23 mm, Stub L5→8: 0,6 mm.
- 40–80 GHz: Buried Via S₁₁ = 4–8 dB (glatt); Through-Hole S₁₁ = 4–10 dB, @32 GHz sprunghaft 13 dB → Transmissionsinstabilität.
- Max Insertion Loss: Buried Via @ 77 GHz; Through-Hole @ 54 GHz.
- Bandbreite (IL < -3 dB): Buried Via 32 GHz; Through-Hole 20 GHz.
- TDR: Buried Via 41,8–52 Ω; Through-Hole 37,5–52 Ω → Buried Via bessere Impedanzkontinuität.
Fazit: Buried Vias bessere Transmissionsqualität (Internal↔Internal).
Einfluss von Via-Durchmesser, Pad, Anti-Pad auf Signalmerkmale
Pad/Anti-Pad fixiert, Via-Radius variiert: 0,1 → 0,175 mm.
- Blind Via Radius 0,1→0,175 mm: Impedanzänderung 6→13,5 Ω; Impedanzdiskontinuität ↑; Insertion Loss S₂₁ Range ↑; max. Dämpfung @ 20–60 GHz: 1,7 dB.
- Buried Via Radius 4→7 mil: Impedanzänderung 10→17 Ω; Diskontinuität ↑; S₂₁ Range ↑; max. Dämpfung @ 20–60 GHz: 1,6 dB.
Via-Durchmesser/Anti-Pad fix, Pad-Radius: 0,2 → 0,28 mm.
- Blind Via Pad 0,2→0,28 mm: Impedanzänderung 6,5→10,5 Ω; S₂₁ Range ↑; max. Dämpfung +2 dB.
- Buried Via Pad 0,2→0,28 mm: Impedanzänderung 10,5→15,5 Ω; Diskontinuität ↑; S₂₁ Range ↑; max. Dämpfung +3,2 dB.
Via-Durchmesser/Pad fix, Anti-Pad: 0,3 → 0,375 mm.
- Blind Via Anti-Pad 0,3→0,375 mm: Impedanzänderung 6,5→5,5 Ω; Diskontinuität ↓; S₂₁ Range ↓; max. Dämpfung +3,2 dB (sic – Originaltext: "increases by 3.2dB" bei abnehmender Diskontinuität – vermutlich Tippfehler im Original, beibehalten).
- Buried Via Anti-Pad 0,3→0,375 mm: Impedanzänderung 10→7,5 Ω; Diskontinuität ↓; S₂₁ Range ↓; max. Dämpfung +3 dB.
Fazit
8-Layer-PCB mit Blind/Buried Vias (HFSS): S-Parameter & TDR Blind/Buried vs. Through-Hole verglichen. Ergebnis: Blind/Buried Vias → geringerer Insertion Loss, bessere Impedanzdiskontinuität. Bei IL < -3 dB: größere Betriebsbandbreite.
Parameteranalyse: Via-Durchmesser↑ & Pad↑ → Insertion Loss-Dämpfung↓ (sic), Impedanzdiskontinuität↑. Anti-Pad↑ → Dämpfung↓, Diskontinuität↓.
Designrichtlinien (IL < -3 dB, Bandbreite ≥ 20 GHz):
- Blind Via Radius ≤ 0,175 mm; Buried Via Radius ≤ 0,23 mm.
- Blind Via Pad ≤ 0,25 mm; Buried Via Pad ≤ 0,275 mm.
- Blind Via Anti-Pad ≥ 0,25 mm; Buried Via Anti-Pad ≥ 0,23 mm.
Designrichtlinien (Impedanzänderung ±10 %):
- Blind/Buried Via Radius ≤ 0,125 mm.
- Blind Via Pad ≤ 0,25 mm; Buried Via Pad ≤ 0,175 mm.
- Blind Via Anti-Pad ≥ 0,275 mm; Buried Via Anti-Pad ≥ 0,4 mm.
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